内存控制器仲裁器和内存访问

内存控制器仲裁器和内存访问

有人知道 DDR 内存控制器上的仲裁器是什么样子的吗?我在想,为了执行内存访问操作重新排序以进行优化,它可能包含 ROB/调度程序/退休之类的架构……有人对实际实施有见解吗?

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